AMD ha anunciado la nueva plataforma Versal Premium Series Gen 2, una familia de SoC adaptativos orientada a tareas con alta intensidad de datos en centros de datos, comunicaciones, análisis, instrumentación, aeroespacial y defensa. La principal novedad es que, según la compañía, se trata de los primeros dispositivos FPGA del sector en integrar compatibilidad con CXL 3.1 y PCIe Gen6, además de soporte para memoria LPDDR5X mediante IP dedicada.
La propuesta de AMD busca resolver un problema muy concreto. Los sistemas modernos necesitan mover más datos y hacerlo con menos latencia. En ese escenario, la combinación de CXL 3.1, PCIe Gen6 y LPDDR5X permite mejorar tanto la conectividad entre CPU y aceleradoras como el acceso a memoria de alta velocidad. AMD plantea esta plataforma como una base para arquitecturas más eficientes, donde el ancho de banda y la disponibilidad de memoria son ya factores decisivos.
Uno de los puntos más importantes del anuncio está en la interconexión. PCIe Gen6 y CXL 3.1 son los encargados de la conectividad entre host y aceleradora. AMD afirma que PCIe Gen6 ofrece entre dos y cuatro veces más velocidad de línea que las FPGA rivales con PCIe Gen4 o Gen5. Además, sostiene que CXL 3.1 sobre PCIe Gen6 duplica el ancho de banda frente a soluciones comparables con CXL 2.1, manteniendo latencias similares y sumando funciones de coherencia y tejido más avanzadas.
AMD apuesta por más ancho de banda de memoria y pone el foco en entornos heterogéneos
La otra gran baza de la serie está en la memoria. Versal Premium Series Gen 2 soporta LPDDR5X de hasta 8.533 Mb/s. Es una cifra que AMD utiliza para subrayar el salto frente a productos comparables basados en LPDDR4 o LPDDR5. A eso se suma la posibilidad de conectar módulos de expansión de memoria CXL. De este modo, se puede ampliar la capacidad y mejorar la utilización de los recursos en configuraciones con varias aceleradoras. La idea es clara: no solo mover datos más rápido, sino repartir mejor la memoria disponible en sistemas complejos.
AMD también ha puesto énfasis en la seguridad. La plataforma integra PCIe Integrity and Data Encryption en hard IP, además de cifrado en línea en controladores de memoria DDR y motores de cifrado 400G. En otras palabras, la compañía no quiere presentar esta familia solo como un salto en rendimiento, sino como una base preparada para mover datos sensibles de forma segura tanto en tránsito como en reposo.
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En cuanto al calendario, AMD prevé liberar las herramientas de desarrollo en el segundo trimestre de 2025. Las primeras muestras de silicio llegarían a comienzos de 2026 y los envíos en producción quedarían para la segunda mitad de ese mismo año.
